Puma (microarquitectura)
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| Puma (Familia 16h segunda generación) | |||||
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| Información | |||||
| Tipo | Microarquitectura | ||||
| Fabricante | |||||
| Fecha de lanzamiento | Mediados de 2014 | ||||
| Descontinuación | presente | ||||
| Datos técnicos | |||||
| Frecuencia de reloj de CPU | 1.35 — 2.5 | ||||
| Longitud del canal MOSFET | 28 nm | ||||
| Conjunto de instrucciones | AMD64 (x86-64) | ||||
| Número de núcleos | 2–4 | ||||
| Caché L1 | 64 KB por núcleo[1] | ||||
| Caché L2 | 1 MB to 2 MB compartida | ||||
| Núcleos | |||||
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| Se conecta a | |||||
| Zócalo(s) |
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| Marcas comerciales | |||||
| Cronología | |||||
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La Familia Puma (16h segunda generación) es una microarquitectura de bajo consumo diseñada por AMD para sus APU. Es el sucesor de Jaguar como una versión de segunda generación, apunta al mismo mercado, y pertenece a la misma familia de arquitectura AMD 16h. La línea de procesadores Beema está dirigida a notebooks de bajo consumo, y Mullins apuntan al sector de las tabletas.
Instrucciones soportadas
Los núcleos de Puma usan la misma microarquitectura de Jaguar, y hereda su diseño:
- Ejecución fuera de orden y Ejecución especulativa, hasta 4 núcleos de CPU
- Two-way integer execution
- Two-way 128-bit wide floating-point and packed integer execution
- Integer hardware divider
- Puma no posee la característica clustered multi-thread (CMT), lo que significa que no hay "módulos"
- Puma no posee la característica Heterogeneous System Architecture o Copia cero[2]
- Instrucciones L1 de 32 KiB + 32 KiB de datos L1 cache por núcleo
- Caché L2 unificada de 1–2 MiB compartida por dos o cuatro núcleos
- Canal de controlador de memoria integrando, soportando DDR3L de 64 bit
- 3.1 mm² de área por núcleo
Al igual que Jaguar, Puma soporta el siguiente conjunto de instrucciones: MMX, SSE, SSE2, SSE3, SSSE3, SSE4a, SSE4.1, SSE4.2, AVX, F16C, CLMUL, AES, BMI1, MOVBE (instrucción Move Big-Endian), XSAVE/XSAVEOPT, ABM (POPCNT/LZCNT), y AMD-V.
Mejoras sobre Jaguar
- Reducción de pérdidas del núcleo de la CPU del 19% a 1,2 V[3]
- 38% de reducción de pérdidas de GPU
- Reducción de 500 mW de energía del controlador de memoria
- Reducción de 200 mW de energía de la interfaz de pantalla
- Temperatura del chasis toma en cuenta turbo boost[4]
- Aumento de poder selectivo según las necesidades de la aplicación (intelligent boost)
- Soporte para ARM TrustZone a través del procesador Cortex-A5
- Soporte para memoria DDR3L-1866[5]
Puma+
AMD lanza una revisión del núcleo de Puma llamado Puma+, como parte de la plataforma Carrizo-L en 2015. Las diferencias en la microarquitectura de la CPU no están claras. Puma + presentó 2 o 4 núcleos hasta 2.5GHz y requirió nuevo Socket FP4.[6]
